Static Timing Analysis

Project : TempHumi
Build Time : 03/25/16 21:46:46
Device : CY8C4125PVI-482
Temperature : -40C - 85C
VDDA : 3.30
VDDD : 3.30
Voltage : 3.3
Expand All | Collapse All | Show All Paths | Hide All Paths
+ Timing Violation Section
No Timing Violations
+ Clock Summary Section
Clock Domain Nominal Frequency Required Frequency Maximum Frequency Violation
CyHFCLK CyHFCLK 6.000 MHz 6.000 MHz N/A
LCD_Clock CyHFCLK 6.000 MHz 6.000 MHz N/A
Trim_Clock CyHFCLK 3.000 MHz 3.000 MHz N/A
I2C_SCBCLK CyHFCLK 2.000 MHz 2.000 MHz N/A
CyILO CyILO 32.000 kHz 32.000 kHz N/A
CyIMO CyIMO 6.000 MHz 6.000 MHz N/A
CyLFCLK CyLFCLK 32.000 kHz 32.000 kHz N/A
CyRouted1 CyRouted1 6.000 MHz 6.000 MHz N/A
CySYSCLK CySYSCLK 6.000 MHz 6.000 MHz N/A
I2C_SCBCLK(FFB) I2C_SCBCLK(FFB) 2.000 MHz 2.000 MHz N/A
LCD_Clock(FFB) LCD_Clock(FFB) 6.000 MHz 6.000 MHz N/A
Trim_Clock(FFB) Trim_Clock(FFB) 3.000 MHz 3.000 MHz N/A